4 to 1 Multiplexer Design using Logical Expression (Verilog CODE)

4 to 1 Multiplexer Design using Logical Expression  (Data Flow Modeling Style)-

Output Waveform : 4 to 1 Multiplexer

Program -



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// Title       : multiplexer4_1
// Design      : vhdl_test
// Author      : Naresh Singh Dobal
// Company     : nsd
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// File        : 4 : 1 Multiplexer using Logical Expression.v



module multiplexer4_1 ( a ,b ,c ,d ,x ,y ,dout );

output dout ;

input a ;
input b ;
input c ;
input d ;
input x ;
input y ;

assign dout = (a & (~x) & (~y)) |
 (b & (~x) & (y)) |
 (c & x & (~y)) |
 (d & x & y);

endmodule